Datasheets - Generación de reloj y CI de distribución - 5

Subsección: "Generación de reloj y CI de distribución"
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  1. CI de distribución de reloj de 1,6 GHz, divisores, ajuste de retardo, tres salidas
  2. IC de distribución de reloj de 800 MHz, divisores, ajuste de retardo, tres salidas
  1. CI de distribución de reloj de 1,6 GHz, divisores, ajuste de retardo, dos salidas
  2. Reloj ultrarrápido SiGe ECL / Buffers de datos
  3. 1.8 V, salida 12-LVDS / 24-CMOS, búfer de distribución de reloj de baja potencia
  4. Seis salidas LVPECL, búfer de despliegue de reloj SiGe
  5. Dos entradas seleccionables, 12 salidas LVPECL, SiGe Clock Fanout Buffer
  6. 1,8 V, 6 salidas LVDS / 12 CMOS Memoria intermedia de baja potencia del reloj Fanout
  7. Dos entradas seleccionables, 8 salidas LVPECL SiGe Clock Fanout Buffer
  8. Dos entradas seleccionables, 10 salidas LVPECL, SiGe Clock Fanout Buffer
  9. 2.5 V / 3.3 V, cuatro salidas LVPECL, SiGe Clock Fanout Buffer
  10. Controlador de reloj programable de bajo voltaje 1:10 LVDS
  11. Búfer de 3.3V de bajo ruido 1: 9, DC - 8 GHz
  12. 1.65 GHz Clock Fanout Buffer con divisores de salida y ajuste de retardo
  13. Ruido de fase baja, divisor / controlador de distribución de reloj de salida triple
  14. Buffer de salida de alto rendimiento, 3.2 GHz, 14 salidas con JESD204B / JESD204C
  15. Bajo ruido, diferencial 2: 8, búfer de abanico
  16. Ultralow Jitter, distribuidor de reloj de 4,5 GHz con 11 salidas y compatibilidad con JESD204B / JESD204C
  17. Ultralow Jitter, 7.5GHz, Familia de búfer de salida de fanout de 11 salidas