Datasheets - Chancletas - 4
Subsección: "Chancletas"
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- Chanclas Octal tipo D con Clear 20-CDIP -55 a 125
- Chanclas Octal tipo D con Clear 20-LCCC -55 a 125
Chanclas de 16 bits de tipo D activadas por borde con salidas de 3 estados 48-CFP -55 a 125
Dispositivos de prueba de escaneo con flip-flops activados por borde tipo D octal 24-CDIP -55 a 125- Dispositivos de prueba de escaneo con flip-flops activados por borde tipo D octal 28-LCCC -55 a 125
Chanclas de interfaz de bus de 8 bits con salidas de 3 estados 28-LCCC -55 a 125
Chanclas de interfaz de bus de 10 bits con salidas de 3 estados 24-CDIP -55 a 125
Lógica CMOS de alta velocidad Doble cierre transparente biestable de 2 bits 16-CDIP -55 a 125
Chanclas JK lógicas de alta velocidad CMOS Logic Dual Edge-Trigger con configuración y reinicio 16-CDIP -55 a 125
Chanclas de interfaz de bus de 10 bits con salidas de 3 estados 24-CDIP -55 a 125
Chanclas de tipo D activadas por borde octal con salidas de 3 estados 20-CDIP -55 a 125- Chanclas de tipo D activadas por borde octal con salidas de 3 estados 20-CFP -55 a 125
- Chanclas de tipo D activadas por borde octal con salidas de 3 estados 20-LCCC -55 a 125
Chanclas hexagonales tipo D con Enable 16-CDIP -55 a 125
Lógica CMOS de alta velocidad con pestillo direccionable de 8 bits 16-CDIP -55 a 125
Chanclas invertidas activadas de borde positivo de tipo D lógico CMOS de alta velocidad con salidas de 3 estados 20-CDIP -55 a 125
Chanclas de alta velocidad CMOS Logic Octal tipo D con habilitación de datos 20-CDIP -55 a 125
Chanclas CMOS Logic Hex tipo D de alta velocidad con reinicio 16-CDIP -55 a 125
Chanclas de tipo D de alta velocidad lógicas CMOS lógicas de borde positivo disparadas con salidas de 3 estados 20-CDIP -55 a 125
Chanclas de doble velocidad CMOS Logic Dual JK con ajuste y reinicio, disparador de borde negativo 16-CDIP -55 a 125